本文關(guān)鍵詞：基于FPGA的同步計數(shù)器的優(yōu)化結(jié)構(gòu)分析

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【摘要】：在數(shù)字信號處理中,同步計數(shù)器是一種非常重要的器件,在很多場所會用到。在基于現(xiàn)場可編程門陣列(FPGA)器件的開發(fā)過程中,人們往往不會注意所用到的同步計數(shù)器內(nèi)部的具體設(shè)計。本文從資源利用率和速率兩個方面,對FPGA開發(fā)綜合工具自動綜合出來的同步計數(shù)器進行分析,并且提出一種結(jié)構(gòu)優(yōu)化的同步計數(shù)器,并將兩種同步計數(shù)器進行對比,得出了兩者的優(yōu)缺點及適用的場合。
【作者單位】： 煙臺大學;
【關(guān)鍵詞】： 同步計數(shù)器 FPGA 資源利用率 速率
【基金】：煙臺大學研究生科技創(chuàng)新基金(基金編號:YDYB1615)
【分類號】：TN911.72;TN791
【正文快照】： 引言計數(shù)是一種最簡單基本的運算,計數(shù)器就是實現(xiàn)這種運算的邏輯電路,計數(shù)器在數(shù)字電路系統(tǒng)中主要是對脈沖的個數(shù)進行計數(shù),以實現(xiàn)測量、計數(shù)和控制的功能[1]。在FPGA設(shè)計中,同步計數(shù)器無處不在,往往被大量的應(yīng)用。作為最基本的邏輯電路,計數(shù)器的性能直接影響整體電路的性能,甚

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