作為通信與電子系統(tǒng)的重要構(gòu)成部分,頻率源起著至關(guān)重要的作用,其性能直接影響系統(tǒng)整體的功能好壞,因此得到了越來(lái)越多的關(guān)注,低相位噪聲、高頻率、寬帶寬、高輸出功率、低雜散、快速變頻、和小頻率步進(jìn)是人們?cè)O(shè)計(jì)的目標(biāo)。根據(jù)設(shè)計(jì)要求,本論文選取合適的設(shè)計(jì)方案,采用DDS驅(qū)動(dòng)PLL的設(shè)計(jì)方案實(shí)現(xiàn)頻率輸出為8-10G,功率輸出大于10dBm,保證分辨率可小于100Hz,在50MHz參考下相噪低于-75dBc/Hz@1k Hz,-80dBc/Hz@10k Hz,-90dBc/Hz@100k Hz,雜散優(yōu)于-42dBc的技術(shù)指標(biāo)。設(shè)計(jì)指標(biāo)的完成主要依賴于硬件的設(shè)計(jì)與調(diào)試,以及軟件的控制,硬件的設(shè)計(jì)包括FPGA的設(shè)計(jì),DDS的設(shè)計(jì),PLL的設(shè)計(jì),以及濾波放大的設(shè)計(jì),軟件的控制為使用Quartus II軟件,利用Verilog HDL語(yǔ)言對(duì)控制程序進(jìn)行編寫。本論文分為六章進(jìn)行撰寫。第一章主要研究頻率源的背景和意義以及國(guó)內(nèi)外的發(fā)展現(xiàn)狀,介紹本課題的主要內(nèi)容,簡(jiǎn)要說(shuō)明本文的章節(jié)安排。第二章主要研究頻率源的基礎(chǔ)理論,講解PLL與DDS的組成以及工作原理,分析其優(yōu)缺點(diǎn),對(duì)其雜散與相位噪聲進(jìn)行分析,為之后的設(shè)計(jì)墊定基礎(chǔ)... 

【文章來(lái)源】：電子科技大學(xué)四川省 211工程院校 985工程院校 教育部直屬院校

【文章頁(yè)數(shù)】：69 頁(yè)

【學(xué)位級(jí)別】：碩士

【部分圖文】：

0G的頻率源

狀環(huán)鎖相的方法設(shè)計(jì)出輸出 60G 的頻率源，滿W，相位噪聲優(yōu)于-65dBc/Hz@10KHz 的目圖 1-1 60G 的頻率源DS+PLL 混合的方案設(shè)計(jì)出輸出 2～12G 的

圖 1-1 60G 的頻率源DDS+PLL 混合的方案設(shè)計(jì)出輸出 2～12G 的圖 1-2 2～12GHz 的超寬帶頻率源 W 波段超低相噪的頻率源，得到當(dāng)輸出頻-90dBc／Hz@10 kHz 的低相噪結(jié)果[16]。其實(shí)

【參考文獻(xiàn)】：
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本文編號(hào)：3468163