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矩陣編碼CGP多目標(biāo)電路進(jìn)化設(shè)計(jì)研究

發(fā)布時(shí)間:2020-08-15 06:44
【摘要】:演化硬件(Evolvable Hardware,EHW)作為一個(gè)新的發(fā)展領(lǐng)域,能夠像生物一樣根據(jù)外部復(fù)雜環(huán)境的變化,自動(dòng)實(shí)時(shí)的調(diào)整電路內(nèi)部的結(jié)構(gòu),通過(guò)進(jìn)化實(shí)現(xiàn)電路的自組織、自修復(fù)和自適應(yīng)等功能。這項(xiàng)技術(shù)的發(fā)展能夠很好的解決在太空、強(qiáng)輻射、深海等人類(lèi)難以到達(dá)、難以進(jìn)行人工修復(fù)的惡劣環(huán)境下的故障處理等問(wèn)題。電路進(jìn)化設(shè)計(jì)是演化硬件的關(guān)鍵技術(shù)之一,是目前演化硬件技術(shù)研究的熱點(diǎn)。電路進(jìn)化設(shè)計(jì)的研究主要包括演化算法(Evolutionary Algorithm,EA)和可編程邏輯器件(Programmable Logic Device,PLD)。基于傳統(tǒng)笛卡爾遺傳規(guī)劃,采用一維向量編碼方案對(duì)電路進(jìn)化設(shè)計(jì)時(shí),易出現(xiàn)早熟、收斂速度慢等問(wèn)題。本文采用二維矩陣編碼方案、逐步降維模塊化分解法進(jìn)行電路進(jìn)化設(shè)計(jì)研究。主要的研究?jī)?nèi)容:(1)研究了(?(10)?)演化策略中種群規(guī)模大小、變異率_cP等參數(shù)與收斂速度的關(guān)系。結(jié)果表明,當(dāng)種群規(guī)模小于5時(shí),隨著種群規(guī)模的增大進(jìn)化代數(shù)很快減少,當(dāng)種群規(guī)模大于5時(shí),種群規(guī)模增加進(jìn)化代數(shù)減少緩慢;變異率在_cP(28).006左右時(shí),進(jìn)化代數(shù)較少。(2)分別采用一維向量編碼方案和二維矩陣編碼方案研究了連接度L與收斂速度、連接度L與激活節(jié)點(diǎn)之間的關(guān)系,研究了可編程邏輯單元數(shù)與收斂速度、可編程邏輯單元數(shù)與激活節(jié)點(diǎn)之間的關(guān)系。結(jié)果表明,連接度L越大,收斂速度快,所用激活節(jié)點(diǎn)數(shù)越少;可編程邏輯單元數(shù)只有取合適的值時(shí),進(jìn)化代數(shù)少,收斂速度快。與一維向量編碼比較,采用二維矩陣編碼方案進(jìn)行電路進(jìn)化設(shè)計(jì)時(shí)收斂速度更快。(3)針對(duì)多目標(biāo)電路提出了逐步降維模塊化分解法,并采用二維矩陣編碼方案對(duì)多目標(biāo)電路進(jìn)化設(shè)計(jì)進(jìn)行研究。該方法能有效地降低電路進(jìn)化設(shè)計(jì)的復(fù)雜程度,提高電路進(jìn)化設(shè)計(jì)的收斂速度。
【學(xué)位授予單位】:河北師范大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2018
【分類(lèi)號(hào)】:TN702
【圖文】:

編碼方案,可編程邏輯,可編程單元


采用 N R Cp個(gè)可編程邏輯節(jié)點(diǎn),每一個(gè)可編程邏輯單元稱(chēng)為可編程單元邏輯節(jié)點(diǎn),每個(gè)可編程邏輯單元代表一個(gè)基本的功能邏輯門(mén),可編程邏輯單元的圖 2.1 CGP 編碼方案

染色體基因,編碼形式,乘法器


以二位乘法器為目標(biāo)電路,對(duì)笛卡爾遺傳規(guī)劃編碼方案進(jìn)行簡(jiǎn)單介紹。二位乘法器有 4 個(gè)終端輸入,4 個(gè)終端輸出,則 4,4ioN N 。選取 12 個(gè)可編程邏輯單元 12N ,節(jié)點(diǎn)數(shù) 16M N N ,節(jié)點(diǎn)編號(hào) 0~15,染色體基因長(zhǎng)度圖 2.3 染色體基因型編碼形式

乘法器,可編程邏輯,功能基因,單元


其中1234A AAA是 4 個(gè)終端輸入,1234O OOO是 4 個(gè)終端輸出。終端輸入和終端輸出之間是 1 行 12 列的可編程邏輯單元,每一個(gè)可編程邏輯單元由 3 個(gè)基因組成,自左向右,第一位基因是功能基因,取值為 0~5,代表 6 種不同的功能。圖 2.4 二位乘法器基因編碼

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10 陳亞娟,王友仁;演化硬件技術(shù)及其在硬件設(shè)計(jì)中的應(yīng)用[J];自動(dòng)化技術(shù)與應(yīng)用;2002年02期

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3 婁建安;趙新青;;演化硬件在時(shí)序數(shù)字電路自適應(yīng)中的研究與實(shí)現(xiàn)[A];全國(guó)高等學(xué)校電子技術(shù)研究會(huì)2008年年會(huì)論文集[C];2008年

4 羅顯志;王W

本文編號(hào):2793761


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