抗輻射加固專用數(shù);旌霞呻娐返脑O計與實現(xiàn)
【學位授予單位】:電子科技大學
【學位級別】:碩士
【學位授予年份】:2018
【分類號】:TN792
【圖文】:
器件布板和所占面積接收器FPGA —— —— 1面積要求 40×40=1600為了減小電路的面積,需要將盡可能多的功能單元集成在單個芯片中,并個管殼進行封裝。按照這種思路分析本電路中的各個功能單元:1)數(shù)字邏輯功能電路:工作電壓 5V,最高工作頻率 10MHz;2)RS-422 接收器/驅動器:按照 RS-422 接口協(xié)議,正常工作電壓為 5V;按計輸入要求,最高工作頻率為 10MHz;3)十通道 8 位 ADC:工作電壓 5V,對十通道模擬輸入信號進行分時采樣。按照 1ms 時間內完成一輪十通道模擬信號采樣轉換進行換算,ADC 的時鐘不超過 1MHz。從上面的分析可以看出,該電路中各個功能單元的最高工作頻率接近,工壓均為 5V,可以用統(tǒng)一工藝將上述功能單元全部集成在單個芯片中,用鋁線在同一個芯片內部形成電連接。最終確定的線路結構如圖 2-1 所示。
圖 2-2 專用數(shù)字邏輯電路正向設計流程計和仿真驗證輸入中對專用數(shù)字邏輯電路的功能描述進行 RTL(ve代碼功能滿足要求,需要對其進行非常詳細的功能仿的工作模式進行仿真,還對預計可能發(fā)生的非正常情進入死循環(huán)或發(fā)出錯誤控制信號。使用 gcvs 軟件來確并在服務器中搭建該設計的仿真驗證環(huán)境。具體的仿。其中:保存有仿真控制的 run 腳本,在該目錄下開始啟動仿存所要驗證的 RTL 代碼和用于仿真的 filelist;保存驗證環(huán)境的各組件,頂層 testbench 和 interface下保存的各個仿真用例文件;保存仿真編譯和執(zhí)行產(chǎn)生的中間文件,以及各 TC log 文件,覆蓋率文件等。
圖 2-3 仿真驗證環(huán)境下的目錄結構仿真驗證中采用 SV 語言+VMM 驗證方法學的架構搭建,驗證平臺的結構如圖 2-4 所示。在頂層 testbench 里面例化了 program,其里面包含了所有用—TC。仿真時,各 TC 約束接口向代碼邏輯發(fā)送配置及激勵信號。仿真運行.fsdb 格式的波形文件,通過 verdi 軟件(即 debussy)觀測波形文件,來確認結果是否正確。驗證環(huán)境里包括了一個用 csh 腳本語言編寫的 run 文件,其可實現(xiàn) VCS 仿的控制和啟動仿真,波形文件的保存、收集覆蓋率等功能。TC通過debussy觀測TestbenchProgram檢查仿真報告DUT
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本文編號:2788658
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