發(fā)布時(shí)間：2020-08-08 14:55

【摘要】：隨著電子技術(shù)的發(fā)展,各種儀器測(cè)試系統(tǒng)的測(cè)量實(shí)時(shí)性及精度要求越來越高。因?yàn)閭鹘y(tǒng)的測(cè)試儀器及系統(tǒng)的實(shí)時(shí)性差、體積大及對(duì)數(shù)字信號(hào)的處理能力有限,所以不滿足當(dāng)今測(cè)試儀器系統(tǒng)的要求。鑒于FPGA具有并行計(jì)算特性且運(yùn)算速度快,DSP可以實(shí)現(xiàn)許多復(fù)雜度較高的算法以及對(duì)外設(shè)控制簡(jiǎn)單。結(jié)合兩者的優(yōu)勢(shì),在儀器測(cè)試系統(tǒng)中采用FPGA+DSP架構(gòu)主流技術(shù)來滿足實(shí)時(shí)性、復(fù)雜算法及精度要求。本課題以基于鑒相法的相位噪聲測(cè)試系統(tǒng)和圖像采集測(cè)試系統(tǒng)為基礎(chǔ)研究FPGA在這兩個(gè)系統(tǒng)中的應(yīng)用。在這兩個(gè)測(cè)試系統(tǒng)中,為了滿足系統(tǒng)的實(shí)時(shí)性等需求,都是以新型的FPGA+DSP架構(gòu)為基礎(chǔ)的,本文主要工作是實(shí)現(xiàn)FPGA在這兩個(gè)測(cè)試系統(tǒng)中的功能。在基于鑒相法的相位噪聲測(cè)試系統(tǒng)中主要完成的工作有:研究了相位噪聲測(cè)試方法中的鑒相法,并對(duì)其進(jìn)行詳細(xì)的理論推導(dǎo);在FPGA的控制下完成高速ADC采集板的工作模式配置及數(shù)據(jù)采集功能;在FPGA內(nèi)部完成高速數(shù)據(jù)的緩存處理,包括數(shù)據(jù)的FIFO緩存處理以及將數(shù)據(jù)存儲(chǔ)至DDR3 SDRAM內(nèi)存條中供DSP在合適的時(shí)間讀取數(shù)據(jù);從理論上研究了積分梳狀濾波器的原理,借助Matlab工具完成積分梳狀濾波器設(shè)計(jì)。根據(jù)積分梳狀濾波器結(jié)構(gòu)完成Verilog HDL代碼設(shè)計(jì),并完成仿真實(shí)現(xiàn),在積分梳狀濾波器后面加上一級(jí)FIR,進(jìn)一步平滑濾波;對(duì)FPGA及DSP之間的Rapid IO通信接口完成包傳輸?shù)姆抡嬖O(shè)計(jì)。在圖像采集測(cè)試系統(tǒng)中,FPGA充當(dāng)著接口橋梁作用。在本測(cè)試系統(tǒng)中主要完成的工作有:詳細(xì)描述了系統(tǒng)的框圖和功能以及對(duì)Camera Link和PAL接口進(jìn)行詳細(xì)介紹;完成了Camera Link及PAL接口的原理圖設(shè)計(jì);在FPGA內(nèi)完成Camera Link接口及編碼后的PAL信號(hào)數(shù)據(jù)傳輸模塊的設(shè)計(jì),將數(shù)據(jù)送至DM6467T的視頻口。在這兩個(gè)測(cè)試系統(tǒng)中,FPGA不僅能完成各種接口的時(shí)序控制,而且在FPGA內(nèi)部可以實(shí)現(xiàn)數(shù)字濾波及數(shù)據(jù)的緩存處理,大大提高了系統(tǒng)的實(shí)時(shí)性要求;豐富的引腳、各式各樣的接口及可編程的接口電壓大大減小了系統(tǒng)的體積。
【學(xué)位授予單位】：西安電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN791;TN911.7

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