發(fā)布時間：2020-06-09 22:38

【摘要】：設(shè)計了一種寬調(diào)節(jié)范圍自適應(yīng)帶寬的低抖動鎖相環(huán)倍頻器(PLL)。通過采用自偏置技術(shù),使得電荷泵電流和運算放大器的輸出阻抗隨工作頻率成比例變化,從而使阻尼因子保持固定、環(huán)路帶寬跟隨輸入?yún)⒖碱l率自動調(diào)整,以及PLL在整個輸出頻率范圍內(nèi)保持最佳的抖動性能。電路采用SMIC 0.18μm CMOS工藝進行設(shè)計,后仿真驗證表明,該PLL電路能夠在0.35~2.1GHz的輸出頻率范圍內(nèi)輸出良好的低抖動信號,輸出頻率為2.1GHz時,均方根抖動為2.47ps。

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本文編號：2705356