一種低時鐘頻率下UHF RFID標(biāo)簽芯片PIE解碼電路的實(shí)現(xiàn)方案
[Abstract]:For tag chips, reducing system clock frequency is the most effective way to reduce power consumption and improve communication distance. In this paper, the lower clock frequency of PIE decoding circuit is deduced theoretically according to an equivalent decision method, and a scheme of UHF RFID tag chip decoding circuit based on ISO 18000-6 TYPE C protocol is proposed. The designed decoding circuit greatly reduces the power consumption of the tag chip decoding circuit and improves the tag response sensitivity.
【作者單位】: 北京智芯微電子科技有限公司國家電網(wǎng)公司重點(diǎn)實(shí)驗(yàn)室電力芯片設(shè)計(jì)分析實(shí)驗(yàn)室;北京智芯微電子科技有限公司北京市電力高可靠性集成電路設(shè)計(jì)工程技術(shù)研究中心;
【分類號】:TN40;TP391.44
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,本文編號:2366564
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