一種基于時間交織流水線架構的高速ADC設計
本文選題:模數轉換器 + 寬帶。 參考:《現代雷達》2017年05期
【摘要】:伴隨著寬帶雷達系統(tǒng)的發(fā)展,信號帶寬越來越大,從而對模數轉換器(ADC)的轉換速度要求也越來越高。為滿足寬帶系統(tǒng)需求,需要ADC能夠在數百兆甚至上GHz轉換速度下實現較高精度的數據轉換,這對ADC芯片設計提出了很高的要求;0.18μm Bi CMOS工藝,設計了一種時間交織流水線架構的超高速ADC,前端采用一個超高速高精度跟蹤保持器,轉換核心采用四路并行流水線時域交織工作,內部集成多相位時鐘控制電路。實測結果表明:該ADC芯片在800 MS/s速度下性能良好,部分通道最高工作速度可達1.2 GS/s。
[Abstract]:With the development of wideband radar system, the signal bandwidth becomes larger and larger, and the conversion speed of ADC becomes higher and higher. In order to meet the requirement of wideband system, ADC is required to realize high precision data conversion at several hundred megabit or even up GHz conversion speed, which puts forward a very high requirement for ADC chip design. Based on 0.18 渭 m Bi CMOS process, an ultra-high speed ADCC with time interleaving pipelined architecture is designed. The front end uses an ultra-high speed and high precision tracking holder, and the conversion core uses four parallel pipelined time domain interleaving. Internal integrated multi-phase clock control circuit. The experimental results show that the ADC chip has good performance at 800 MS / s speed, and the maximum operating speed of some channels can reach 1.2 GS / s.
【作者單位】: 南京電子技術研究所;
【分類號】:TN792
【參考文獻】
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,本文編號:2104184
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