本文選題：模數(shù)轉(zhuǎn)換器 + 寬帶��； 參考：《現(xiàn)代雷達(dá)》2017年05期

【摘要】：伴隨著寬帶雷達(dá)系統(tǒng)的發(fā)展,信號(hào)帶寬越來(lái)越大,從而對(duì)模數(shù)轉(zhuǎn)換器(ADC)的轉(zhuǎn)換速度要求也越來(lái)越高。為滿足寬帶系統(tǒng)需求,需要ADC能夠在數(shù)百兆甚至上GHz轉(zhuǎn)換速度下實(shí)現(xiàn)較高精度的數(shù)據(jù)轉(zhuǎn)換,這對(duì)ADC芯片設(shè)計(jì)提出了很高的要求�；�0.18μm Bi CMOS工藝,設(shè)計(jì)了一種時(shí)間交織流水線架構(gòu)的超高速ADC,前端采用一個(gè)超高速高精度跟蹤保持器,轉(zhuǎn)換核心采用四路并行流水線時(shí)域交織工作,內(nèi)部集成多相位時(shí)鐘控制電路。實(shí)測(cè)結(jié)果表明:該ADC芯片在800 MS/s速度下性能良好,部分通道最高工作速度可達(dá)1.2 GS/s。
[Abstract]:With the development of wideband radar system, the signal bandwidth becomes larger and larger, and the conversion speed of ADC becomes higher and higher. In order to meet the requirement of wideband system, ADC is required to realize high precision data conversion at several hundred megabit or even up GHz conversion speed, which puts forward a very high requirement for ADC chip design. Based on 0.18 渭 m Bi CMOS process, an ultra-high speed ADCC with time interleaving pipelined architecture is designed. The front end uses an ultra-high speed and high precision tracking holder, and the conversion core uses four parallel pipelined time domain interleaving. Internal integrated multi-phase clock control circuit. The experimental results show that the ADC chip has good performance at 800 MS / s speed, and the maximum operating speed of some channels can reach 1.2 GS / s.
【作者單位】： 南京電子技術(shù)研究所;
【分類號(hào)】：TN792

【參考文獻(xiàn)】

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本文編號(hào)：2104184