本文選題：可編程分頻器 + 占空比設置　； 參考：《微電子學》2017年05期

【摘要】：提出了一種改進的寬分頻比范圍可編程分頻器,支持對分頻數(shù)和占空比的編程設置。該結(jié)構(gòu)由改進的可編程下行異步計數(shù)器和脈沖二分頻器組成,采用置數(shù)自釋放結(jié)構(gòu)和"時間裕度借用"方法,將關(guān)鍵路徑延時容忍度增大了一個時鐘周期。提出的分頻器采用0.13μm CMOS工藝進行設計與流片,版圖尺寸為38.5μm×66.2μm。流片后的測試結(jié)果表明,該分頻器的分頻比范圍為2~1 022,在分頻比為m的條件下,占空比可從1/m調(diào)節(jié)至(m-1)/m。在全分頻范圍內(nèi),工作速度可達1.85GHz,功耗小于0.82mW。
[Abstract]:An improved wide frequency division ratio range programmable frequency divider is proposed, which supports the programming of frequency division number and duty ratio. The structure is composed of an improved programmable downlink asynchronous counter and a pulse two divider. A self releasing structure and a "time margin borrowing" method are used to increase the time tolerance of critical path time. The proposed frequency divider uses 0.13 m CMOS process to design and flow sheet. The test results after the size of 38.5 m x 66.2 mu m. show that the frequency division ratio range of the divider is 2~1 022, and the duty ratio can be adjusted from 1/m to (m-1) /m. in the full frequency range under the condition of the frequency division ratio of M, and the working speed can reach 1.85GHz and the power consumption is less than 0.8. 2mW.
【作者單位】： 中國科學院電子學研究所;中國科學院大學;
【基金】：國家自然科學基金資助項目(61474120)
【分類號】：TN772

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本文編號：1926467