本文選題：數(shù)模轉換器 + 權電容陣列��； 參考：《北京交通大學學報》2017年02期

【摘要】：為提高權電容陣列DAC的性能,本文通過建立權電容陣列DAC的理想模型和狀態(tài)轉換模型,求解出零狀態(tài)輸出和非零狀態(tài)輸出,證明了權電容陣列DAC輸出僅包含系統(tǒng)的零狀態(tài)響應,而與前次輸入無關.根據(jù)權電容陣列DAC的頻率響應特性和時域響應函數(shù),得到一種電容陣列DAC轉換速度的估計方法,并建立了支路時間常數(shù)與轉換開關導通電阻之間的限制關系.通過仿真分析驗證了權電容陣列DAC轉換速度的估計方法,為權電容陣列DAC的設計和應用提供了理論依據(jù).
[Abstract]:In order to improve the performance of the weighted capacitor array (DAC), the ideal model and the state transition model of the DAC are established, and the zero-state output and the non-zero-state output are obtained. It is proved that the output of the weighted capacitor array DAC includes only the zero-state response of the system. It has nothing to do with the previous input. According to the frequency response characteristics and time domain response function of the weighted capacitor array (DAC), a method for estimating the conversion speed of the capacitor array DAC is obtained, and the limiting relation between the branch time constant and the on-resistance of the switching switch is established. The method of estimating the conversion speed of the weighted capacitor array (DAC) is verified by simulation analysis, which provides a theoretical basis for the design and application of the weighted capacitor array (DAC).
【作者單位】： 北京交通大學電子信息工程學院;北京聯(lián)合大學信息學院;
【基金】：國家自然科學基金(61273061)~~
【分類號】：TN792

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本文編號：1875828