發(fā)布時(shí)間：2018-04-21 04:00

  本文選題：低功耗 + 自適應(yīng)電壓調(diào)節(jié)�。� 參考：《電子科技大學(xué)》2015年碩士論文

【摘要】：隨著集成電路技術(shù)的進(jìn)步,工藝線寬越來(lái)越小,在同樣的芯片面積下可以集成越來(lái)越多的功能,芯片的功耗問(wèn)題變得越來(lái)越突出。同時(shí),隨著集成電路的飛速發(fā)展,諸如智能手機(jī)、平板電腦等移動(dòng)設(shè)備的功能越來(lái)越多,體積越來(lái)越小,在電池技術(shù)發(fā)展滯后的情況下,運(yùn)用低功耗技術(shù)能夠延長(zhǎng)設(shè)備的使用時(shí)間。在眾多的低功耗技術(shù)中,自適應(yīng)電壓調(diào)節(jié)技術(shù)(Adaptive Voltage Scaling,AVS)可顯著降低負(fù)載能耗,從而越來(lái)越受到人們的重視。本文在分析了幾種不同的電源管理技術(shù)之后,提出了一種基于主極點(diǎn)補(bǔ)償?shù)腁VS電路,它利用環(huán)路中的一個(gè)加減雙向計(jì)數(shù)模塊產(chǎn)生的一個(gè)低頻極點(diǎn)來(lái)使得環(huán)路穩(wěn)定,該計(jì)數(shù)模塊通過(guò)控制數(shù)字脈寬調(diào)制器(Digital Pulse Width Modulator,DPWM)的輸出占空比來(lái)調(diào)節(jié)輸出電壓。功率級(jí)電路基于轉(zhuǎn)換效率較高的Buck拓?fù)浣Y(jié)構(gòu),采用同步整流方式進(jìn)一步提高效率。本文在闡述了系統(tǒng)構(gòu)成及工作原理之后,著重分析并設(shè)計(jì)了高線性度的DPWM模塊,該DPWM模塊采用了延遲鏈加計(jì)數(shù)比較的混合式結(jié)構(gòu)。在該模塊的設(shè)計(jì)中,提出了一種新穎的延遲鏈校準(zhǔn)方式,按照特定的校準(zhǔn)順序?qū)ρ舆t鏈中每一級(jí)延遲時(shí)間進(jìn)行調(diào)整,較大程度地提高了其積分非線性(Integral nonlinearity,INL)。論文所設(shè)計(jì)AVS電路屬于數(shù)�；旌霞呻娐�,通過(guò)數(shù)�；旌显O(shè)計(jì)和仿真流程,驗(yàn)證了系統(tǒng)功能的正確性,在不同的頻率下電路能夠自適應(yīng)地調(diào)節(jié)出相應(yīng)的電壓。電路輸入電壓為2.7V-4.2V,輸出電壓為0.9V-2.2V。所設(shè)計(jì)的電路最終在CMOS0.18μm工藝下進(jìn)行了流片,整個(gè)芯片的版圖面積為1300μm×1150μm。經(jīng)過(guò)仿真分析,相對(duì)于DVS技術(shù),該AVS技術(shù)能節(jié)省最多46%的能耗。
[Abstract]:......
【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類號(hào)】：TN402

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本文編號(hào)：1780819