本文選題：相位切換型預(yù)分頻器　切入點(diǎn)：可編程分頻器　出處：《南京郵電大學(xué)學(xué)報(bào)(自然科學(xué)版)》2017年01期

【摘要】：提出了一種低功耗的可編程分頻器,包括相位切換型預(yù)分頻器和可編程計(jì)數(shù)器,將相位切換預(yù)分頻器中的相位選擇器和二分頻器組成套疊結(jié)構(gòu),降低了互連損耗和失配,省去了緩沖器以及二分頻器的功耗,實(shí)現(xiàn)了一種低功耗的相位切換預(yù)分頻器。將程序計(jì)數(shù)器和脈沖吞咽計(jì)數(shù)器中D觸發(fā)器進(jìn)行共用,使計(jì)數(shù)器中D觸發(fā)器的總數(shù)減少了一半,降低了可編程計(jì)數(shù)器的面積和功耗。采用SMIC 0.18μm CMOS工藝實(shí)現(xiàn)了相位選擇器與二分頻電路,并將之集成于4.8 GHz頻段鎖相環(huán)頻率綜合器中,工作頻率為4.64~5.40 GHz,在1.8 V電源電壓下,分頻器消耗電流3 m A,其中相位選擇器僅消耗550μA。
[Abstract]:A low power programmable frequency divider, which includes phase switching predivider and programmable counter, is proposed. The phase selector and two frequency divider in the phase switching predivider are composed of two frequency dividers, which can reduce the interconnection loss and mismatch. The power consumption of buffer and frequency divider is eliminated, and a phase switched predivider with low power consumption is realized. The D flip-flop in the program counter and pulse swallow counter is shared, the total number of D flip-flop in the counter is reduced by half. The area and power consumption of the programmable counter are reduced. The phase selector and the frequency division circuit are realized by SMIC 0.18 渭 m CMOS process, and integrated in the 4.8 GHz band PLL frequency synthesizer. The working frequency is 4.64 渭 m 5.40 GHz, and the power supply voltage is 1.8 V. The frequency divider consumes a current of 3 Ma, in which the phase selector consumes only 550 渭 A.
【作者單位】： 南京郵電大學(xué)電子科學(xué)與工程學(xué)院;
【基金】：江蘇省自然科學(xué)基金(BK20130880) 江蘇省高校自然科學(xué)基金(14JB510025)資助項(xiàng)目
【分類(lèi)號(hào)】：TN772

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本文編號(hào)：1663540