本文選題：SoC測試　切入點：遺傳算法　出處：《微電子學與計算機》2017年01期 　論文類型：期刊論文

【摘要】：針對現(xiàn)有SoC測試方法所需測試時間過長的問題,提出了一種基于遺傳算法的多IP核并行測試方法.該方法主要是在功耗約束的情況下,通過遺傳算法將盡可能多的IP核的測試數(shù)據(jù)壓縮,即IP核的測試數(shù)據(jù)相同的位接到同一根總線數(shù)據(jù)位,使每次并行測試的IP核數(shù)量達到最大.此方法不僅可以減少測試數(shù)據(jù)集的大小,且能夠減少對總線位寬的需求.通過應用遺傳算法對所建立測試數(shù)據(jù)求取最佳測試方案的仿真,證明了該方法是可行的,且能夠極大縮短測試時間.
[Abstract]:Aiming at the problem that the test time is too long for the existing SoC testing methods, a parallel testing method for multi-IP cores based on genetic algorithm is proposed, which is mainly based on power constraints. The test data of as many IP cores as possible are compressed by genetic algorithm, that is, the same bit of test data of IP core is connected to the same bus data bit. This method can not only reduce the size of test data set, but also reduce the requirement of bus bit width. It is proved that this method is feasible and can greatly shorten the test time.
【作者單位】： 桂林電子科技大學電子工程與自動化學院;
【分類號】：TN431

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