本文關(guān)鍵詞：用于FPGAIP保護的低成本高性能PUF設(shè)計

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【摘要】：隨著現(xiàn)場可編程門陣列在電子系統(tǒng)設(shè)計中的廣泛應(yīng)用,人們越來越重視基于現(xiàn)場可編程門陣列的知識產(chǎn)權(quán)保護問題.但在實際應(yīng)用中,在現(xiàn)場可編程門陣列上實現(xiàn)環(huán)形振蕩器型物理不可克隆函數(shù)還面臨著諸多挑戰(zhàn),如環(huán)形振蕩器型物理不可克隆函數(shù)電路的面積消耗很大;有限的邏輯資源使得激勵響應(yīng)對數(shù)量有限,限制了該知識產(chǎn)權(quán)保護方法的應(yīng)用范圍.為了解決這些問題,首先提出了一種邏輯混合技術(shù).該技術(shù)把物理不可克隆函數(shù)邏輯和正常電路邏輯在現(xiàn)場可編程門陣列實現(xiàn)中混合起來,以減少物理不可克隆函數(shù)的電路面積消耗.其次,采用了一種后處理方法,極大地增加了所設(shè)計環(huán)形振蕩器型物理不可克隆函數(shù)的激勵響應(yīng)對數(shù)量.實驗結(jié)果顯示,文中設(shè)計的物理不可克隆函數(shù)的性能優(yōu)異,可靠性、隨機性和獨特性分別為99.97%、50.37%、49.83%.同時,消耗的硬件資源比其他同等性能的物理不可克隆函數(shù)少了45%.
【作者單位】： 天津大學(xué)電子信息工程學(xué)院;
【基金】：國家自然科學(xué)基金資助項目(61204022)
【分類號】：TN791
【正文快照】： 近年來,現(xiàn)場可編程門陣列(Field Programmable Gata Array,FPGA)在電子系統(tǒng)設(shè)計中的應(yīng)用越來越廣泛[1].FPGA設(shè)計知識產(chǎn)權(quán)(Intellectual Property,IP)侵權(quán)問題日益嚴(yán)峻.偽造是一種典型的IP侵權(quán)行為,侵權(quán)者非法使用他人品牌或者直接復(fù)制他人設(shè)計來謀取利益.近幾年,研究人員提出

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本文編號：1173710