基于單片機控制的PM2.5空氣凈化器的設計與研究
【圖文】:
57ELECTRONICSWORLD探索與觀察圖4基于CPLD的多電源上電時序的控制設計流程圖3基于CPLD的多電源上電時序的控制為了達到更精確,更穩(wěn)定的上電時序,在原有的上電時序的方式中,做出改進,通過CPLD來控制多電源的上電時序。在DC-DC線性穩(wěn)壓器模塊中由“ON/OFF”或者“EN/SSN”引腳,用來使能電源模塊的輸出,而本文的設計就是利用CPLD來控制這些使能引腳,已達到精確的控制電源上電時序的目的,如圖3所示采用可編程邏輯器件CPLD的設計具有較強的靈活性,通過硬件描述語言對其進行編程設計;贑PLD的多電源上電時序的控制設計流程圖如圖4所示。首先禁止所有的電源模塊輸出,使能CPU、FPGA和DSP等器件的復位功能;通過CPLD的計數(shù)來控制延時輸出使能信號,達到精確的控制上電時序的目的;使能信號使能電源模塊輸出各個電壓,并檢測各個電壓的輸出情況,當正確時,電壓輸出后使能時鐘信號,,然后結束復位,當不正確時觸發(fā)報警復位等處理。4結束語本文闡述了基于CPLD的多電源上電時序的控制的一種設計方案,并和利用延時電路來控制上電時序進行了了對比,而基于CPLD控制的上電時序則更加可靠和穩(wěn)定,比延遲電路更加精確,因為CPLD能靈活和更準確的編程實現(xiàn)計數(shù)延時,并且CPLD受環(huán)境的影響相對較校參考文獻[1]MCF548xColdFireMicroprocessor,Rev.4[Z].Freescale,2007.[2]劉寶明,蘇培培.高功耗嵌入式單板計算機的電源設計與實現(xiàn)[J].計算機工程與設計,2012,33(3):941-946.[3]廖建興.通信設備低壓BUCK電源模塊設計要求[J].應用分析,2015,1:46-50.作者簡介:馬茗崗(1989—),男,碩士研究生,主要從事列控車載信號的研究與應用。(上接第55頁)引發(fā)的火災后,系統(tǒng)采集到火災信息后,通過報警器發(fā)出報警聲與撥通戶主手機進行雙重報
57ELECTRONICSWORLD探索與觀察圖4基于CPLD的多電源上電時序的控制設計流程圖3基于CPLD的多電源上電時序的控制為了達到更精確,更穩(wěn)定的上電時序,在原有的上電時序的方式中,做出改進,通過CPLD來控制多電源的上電時序。在DC-DC線性穩(wěn)壓器模塊中由“ON/OFF”或者“EN/SSN”引腳,用來使能電源模塊的輸出,而本文的設計就是利用CPLD來控制這些使能引腳,已達到精確的控制電源上電時序的目的,如圖3所示采用可編程邏輯器件CPLD的設計具有較強的靈活性,通過硬件描述語言對其進行編程設計;贑PLD的多電源上電時序的控制設計流程圖如圖4所示。首先禁止所有的電源模塊輸出,使能CPU、FPGA和DSP等器件的復位功能;通過CPLD的計數(shù)來控制延時輸出使能信號,達到精確的控制上電時序的目的;使能信號使能電源模塊輸出各個電壓,并檢測各個電壓的輸出情況,當正確時,電壓輸出后使能時鐘信號,然后結束復位,當不正確時觸發(fā)報警復位等處理。4結束語本文闡述了基于CPLD的多電源上電時序的控制的一種設計方案,并和利用延時電路來控制上電時序進行了了對比,而基于CPLD控制的上電時序則更加可靠和穩(wěn)定,比延遲電路更加精確,因為CPLD能靈活和更準確的編程實現(xiàn)計數(shù)延時,并且CPLD受環(huán)境的影響相對較校參考文獻[1]MCF548xColdFireMicroprocessor,Rev.4[Z].Freescale,2007.[2]劉寶明,蘇培培.高功耗嵌入式單板計算機的電源設計與實現(xiàn)[J].計算機工程與設計,2012,33(3):941-946.[3]廖建興.通信設備低壓BUCK電源模塊設計要求[J].應用分析,2015,1:46-50.作者簡介:馬茗崗(1989—),男,碩士研究生,主要從事列控車載信號的研究與應用。(上接第55頁)引發(fā)的火災后,系統(tǒng)采集到火災信息后,通過報警器發(fā)出報警聲與撥通戶主手機進行雙重報
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