基于FPGA的水聲信號(hào)數(shù)字下變頻的實(shí)現(xiàn)
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更多相關(guān)文章: 聲吶 水聲信號(hào) 濾波 降采樣 FPGA
【摘要】:隨著聲吶信號(hào)處理技術(shù)的發(fā)展,其對(duì)系統(tǒng)的軟、硬件資源要求越來(lái)越高。利用數(shù)字下變頻技術(shù),可極大地降低其信號(hào)處理資源要求。結(jié)合Matlab,仿真研究整個(gè)下變頻過(guò)程,驗(yàn)證分析水聲信號(hào)數(shù)字下變頻的正確性。在此基礎(chǔ)上,應(yīng)用Verilog語(yǔ)言移植算法到FPGA內(nèi)部,在Signaltap II下觀察過(guò)程變量及結(jié)果,并導(dǎo)入Matlab進(jìn)行數(shù)據(jù)分析。該技術(shù)對(duì)于聲吶信號(hào)處理具有實(shí)用價(jià)值,并已成功應(yīng)用于某聲吶設(shè)備。
【作者單位】: 中國(guó)船舶重工集團(tuán)公司第七一五研究所;
【關(guān)鍵詞】: 聲吶 水聲信號(hào) 濾波 降采樣 FPGA
【基金】:國(guó)家“863”計(jì)劃資助項(xiàng)目(2011AA09A107)
【分類號(hào)】:U666.7
【正文快照】: 在數(shù)字采集系統(tǒng)中,一方面希望信號(hào)采樣時(shí)用盡可能高的采樣率;另一方面在信號(hào)處理時(shí)又希望盡可能降低信號(hào)速率,以降低對(duì)信號(hào)處理器件的性能要求[1]。這兩者看似矛盾的需求,在數(shù)字下變頻技術(shù)的支持下,成為一個(gè)有機(jī)整體。在水聲聲吶系統(tǒng)的接收機(jī)中,也正不斷借鑒其技術(shù),對(duì)水聲信號(hào)
【相似文獻(xiàn)】
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,本文編號(hào):764715
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