【摘要】：高性能計(jì)算機(jī)峰值性能的不斷攀升給高性能互連網(wǎng)絡(luò)帶來新的挑戰(zhàn);同時(shí),串行傳輸技術(shù)的發(fā)展使芯片引腳帶寬增長,使用高階路由器應(yīng)對(duì)高性能互連網(wǎng)絡(luò)新挑戰(zhàn)的時(shí)機(jī)已經(jīng)成熟。因此,如何利用高階路由器所提供的豐富互連端口提升高性能互連網(wǎng)絡(luò)的性能和減少高性能互連網(wǎng)絡(luò)開銷是設(shè)計(jì)高性能互連網(wǎng)絡(luò)拓?fù)浣Y(jié)構(gòu)的關(guān)鍵。針對(duì)目前基于高階路由器的典型拓?fù)浣Y(jié)構(gòu)進(jìn)行了理論分析,并與傳統(tǒng)k元n立方體進(jìn)行了對(duì)比分析。通過在一個(gè)基于OMNeT++平臺(tái)自組開發(fā)的高階互連網(wǎng)絡(luò)性能測(cè)評(píng)模擬器上設(shè)定不同的通信負(fù)載,測(cè)評(píng)分析了不同的拓?fù)浣Y(jié)構(gòu)在通信系統(tǒng)下實(shí)際的網(wǎng)絡(luò)延遲和吞吐率的走勢(shì),簡要分析了典型高階互連網(wǎng)絡(luò)拓?fù)浣Y(jié)構(gòu)的局限性。
[Abstract]:The rising peak performance of high performance computers brings new challenges to high performance interconnection networks. At the same time, with the development of serial transmission technology, the chip pin bandwidth increases, and the time is ripe to use high-order routers to deal with the new challenges of high-performance interconnection networks. Therefore, how to improve the performance of high performance interconnection networks and reduce the overhead of high performance interconnection networks by using the rich interconnection ports provided by high order routers is the key to design the topology of high performance interconnection networks. The typical topology structure based on high order router is analyzed theoretically and compared with the traditional k-ary n-cube. By setting different communication load on a high-order interconnection network performance evaluation simulator based on OMNeT platform, the trend of network delay and throughput of different topology in communication system is analyzed. The limitations of typical high-order interconnection network topology are briefly analyzed.
【作者單位】： 國防科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院;
【基金】：國家自然科學(xué)基金資助項(xiàng)目(61272483,61272482,61003301)
【分類號(hào)】：TP393.02

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本文編號(hào)：2325186